EPM240T100I5 vs EPM240T100I3N Comparaison
Comparaison détaillée côte à côte de EPM240T100I5 par Intel et EPM240T100I3N par Intel. Comparez les spécifications clés, les paramètres électriques, le conditionnement, le statut de cycle de vie, les prix et la disponibilité pour déterminer le meilleur composant pour vos exigences de conception.
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EPM240T100I3N - 192-Macrocell MAX II CPLD, 100-TQFP, Industrial | Intel
EPM240T100I3N ⚠ Dernier achatComparaison des spécifications
| Paramètre | EPM240T100I5 | EPM240T100I3N |
|---|---|---|
| Marque | Intel | Intel |
| Catégorie | FPGA & CPLD | FPGA & CPLD |
| Statut du cycle de vie | Actif | Dernier achat |
| Statut du stock | In Stock | In Stock |
| Prix unitaire (USD) | $5,88 | $5,45 |
| Family | MAX II | MAX II |
| Series | EPM240 | — |
| Device Sub-family | EPM240T100 | — |
| Logic Elements (LE) | 240 | — |
| Equivalent Macrocells | 192 | — |
| User Flash Memory (UFM) | 8 Kbits | — |
| Maximum User I/O Pins | 80 | 80 |
| Boîtier | TQFP-100 (100-pin) | TQFP-100 (T100), 14x14 mm, 0.5 mm pitch |
| Température de fonctionnement | -40C to +100C (industrial) | — |
| Speed Grade | I5 | 3 |
| Core Voltage | 3.3 V | — |
| MultiVolt I/O Support | 1.5 V / 1.8 V / 2.5 V / 3.3 V | 1.5 V / 1.8 V / 2.5 V / 3.3 V |
| Propagation Delay (typical) | 4-7 ns | — |
| Programming Interface | JTAG (IEEE 1149.1) / ISP | JTAG / IEEE 1149.1 ISP |
| Type de montage | Surface Mount | — |
| Statut RoHS | [DATA_NEEDED: rohs status] | Compliant |
| Device Logic Elements / Macrocells | — | 192 macrocells |
| Number of Logic Array Blocks (LABs) | — | 4 |
| On-chip User Flash Memory | — | 8 Kbits |
| Internal Performance | — | 304 MHz |
| Pin-to-pin Logic Delay (tPD1) | — | 4.6 ns |
| Global Clock Networks | — | 4 |
| Technology Node | — | 0.18 um, 6-layer-metal flash CMOS |
| Supply Voltage - Core | — | 2.5 V / 3.3 V |
| Température de jonction en fonctionnement | — | -40C to +100C (industrial, 'I' grade) |
| Instant-on (non-volatile) | — | Yes (flash-based) |
| Niveau MSL | — | 3 (per JEDEC J-STD-020) |