LC4064B-5T48I vs LC4064B-5T48C तुलना

विस्तृत दोनों ओर की तुलना LC4064B-5T48I द्वारा Lattice Semiconductor और LC4064B-5T48C द्वारा Lattice Semiconductor. मुख्य विशेषताओं, इलेक्ट्रिकल पैरामीटर, पैकेजिंग, चक्र स्थिति, मूल्यांकन और उपलब्धता को तुलना करके अपनी डिजाइन की आवश्यकताओं के लिए सबसे अच्छा घटक निर्धारित करें。

Lattice Semiconductor
LC4064B-5T48I LC4064B-5T48I - 64-Macrocell 5ns ISP CPLD | Lattice

LC4064B-5T48I - 64-Macrocell 5ns ISP CPLD | Lattice

LC4064B-5T48I ✓ सक्रिय
Lattice Semiconductor
LC4064B-5T48C LC4064B-5T48C - 64-Macrocell 400 MHz CPLD | Lattice

LC4064B-5T48C - 64-Macrocell 400 MHz CPLD | Lattice

LC4064B-5T48C ✓ सक्रिय

विशेषता तुलना

पैरामीटर LC4064B-5T48I LC4064B-5T48C
ब्रांड Lattice Semiconductor Lattice Semiconductor
श्रेणी FPGA & CPLD FPGA & CPLD
लाइफसाइकिल स्थिति सक्रिय सक्रिय
Product Type SuperFAST high-density programmable logic device (CPLD) —
Device Series ispMACH 4000B —
Number of Macrocells 64 macrocells —
Number of I/O 32 I/O —
Speed Grade 5 ns —
Programming Type In-system programmable (ISP) —
Supported Supply Voltages 1.8 V, 2.5 V, and 3.3 V 3.3 V, 2.5 V, and 1.8 V
पैकेज 48-LQFP (TQFP-48) —
माउंटिंग प्रकार Surface mount Surface mount
ऑपरेटिंग तापमान रेंज -40 °C to +105 °C (junction temperature) [DATA_NEEDED: operating temperature range]
Logic Family ispMACH 4000B SuperFAST high-density PLD SuperFAST high-density PLD family
अधिकतम क्लॉक फ़्रीक्वेंसी [DATA_NEEDED: maximum clock frequency] —
सप्लाई करंट [DATA_NEEDED: supply current] —
Output Drive Current [DATA_NEEDED: output drive current] —
ऑपरेटिंग तापमान [DATA_NEEDED: operating ambient temperature range] —
RoHS स्थिति [DATA_NEEDED: RoHS status] [DATA_NEEDED: RoHS status]
REACH Status [DATA_NEEDED: REACH status] [DATA_NEEDED: REACH status]
AEC-Q100 Qualification [DATA_NEEDED: AEC-Q100 qualification] [DATA_NEEDED: AEC-Q100 qualification status]
Lead-Free Status [DATA_NEEDED: lead-free status] —
Device Type — In-System Programmable SuperFAST High-Density PLD
Macrocell Count — 64 macrocells
Maximum Operating Frequency — 400 MHz
Propagation Delay — 2.5 ns
Configuration Method — In-system programmable
Global Clock Pins — Up to 4 pins
Clock Polarity Control — Programmable
Product-Term Outputs per Macrocell — Up to 80 PTs per output
Package Type — 48-pin TQFP
पिन काउंट — 48 pins
Programmable Logic Type — Complex programmable logic device (CPLD)
I/O Pin Count — [DATA_NEEDED: I/O pin count]
Configuration Memory — [DATA_NEEDED: configuration memory details]

डेटाशीट और संसाधन

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