EPM3512AQC208-2 vs EPM3512AQC208-7 Comparação

Comparação detalhada lado a lado de EPM3512AQC208-2 por Altera e EPM3512AQC208-7 por Intel. Compare especificações principais, parâmetros elétricos, encapsulamento, status do ciclo de vida, preços e disponibilidade para determinar o melhor componente para os requisitos do seu projeto.

Comparação de especificações

Parâmetro EPM3512AQC208-2 EPM3512AQC208-7
Marca Altera Intel
Categoria FPGA & CPLD FPGA & CPLD
Status do ciclo de vida Obsolete NRND
Status do estoque In Stock In Stock
Preço unitário (USD) $18,75 $41,72
Family MAX 3000A MAX 3000A
Macrocells 512 512
User I/O Pins 172 —
Logic Array Blocks (LABs) 16 —
Speed Grade -2 —
Encapsulamento PQFP-208 (QC) 208-Pin PQFP (FQFP, gull-wing)
Supply Voltage (Core) 3.3 V —
Output Drive Voltage 2.5 V / 3.3 V programmable —
Input Voltage Tolerance 2.5 V / 3.3 V / 5.0 V —
Process Technology 0.30 µm EEPROM CMOS EEPROM, 0.30 um
Program/Erase Endurance 100 cycles (typical) —
In-System Programmability Yes (IEEE 1149.1 JTAG) —
User I/O Banks 4 —
Faixa de temperatura de operação Commercial (0C to +70C) —
Tipo de montagem Surface Mount —
Status RoHS Non-compliant (legacy PQFP) Compliant
Lead-Free No (SnPb lead finish) Yes
Security Bit Yes (programmable) —
Device Type — CPLD (Complex Programmable Logic Device)
Usable Gates — 10,000
Propagation Delay (tPD) — 7.5 ns
Counter Frequency (fCNT) — 116.3 MHz
User I/Os — 172
Logic Elements / LEs — N/A (CPLD macrocell architecture)
Supply Voltage (VCCINT) — 3.3 V
I/O Standards Supported — 5.0 V, 3.3 V, 2.5 V (MultiVolt I/O)
Temperatura de operação — 0 C to +70 C (commercial)
Programming — In-System Programmable via JTAG (IEEE Std. 1532)

Fichas técnicas e recursos

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