EPM5128JC-1 vs EPM5128JC-2 השוואה

השוואה מפורטת זה לצד זה של EPM5128JC-1 מאת Altera ו EPM5128JC-2 מאת Altera. השווה מפרטים עיקריים, פרמטרים חשמליים, אריזה, סטטוס מחזור חיים, תמחור וזמינות כדי לקבוע את הרכיב הטוב ביותר לדרישות העיצוב שלך.

השוואת מפרטים

פרמטר EPM5128JC-1 EPM5128JC-2
מותג Altera Altera
קטגוריה FPGA & CPLD FPGA & CPLD
סטטוס מחזור חיים Obsolete Obsolete
Family MAX 5000 MAX 5000
Device Type Erasable Programmable Logic Device (EPLD/CPLD) UV-Erasable Programmable Logic Device (PLD)
Macrocells 128 128
Usable Gates 2,500 —
Logic Array Blocks (LABs) [DATA_NEEDED: LAB count] —
Maximum Operating Frequency 62.5 MHz —
Pin-to-Pin Propagation Delay (tPD) 40 ns —
Supply Voltage (VCC) 4.75 V to 5.25 V (5 V nominal) —
Technology CMOS, UV-erasable EPROM —
מארז 68-pin CQCCJ (Windowed Ceramic J-Lead Chip Carrier) 68-pin CQCC (Ceramic Quad Flat Pack), windowed
סוג הרכבה Surface Mount Surface Mount
טמפרטורת פעולה [DATA_NEEDED: temperature grade] [DATA_NEEDED: operating temperature range]
Programming Interface JTAG / Altera dedicated programmer —
Configuration Memory Non-volatile EPROM (UV-erasable) —
סטטוס RoHS non_compliant (ceramic windowed package) Non-compliant (ceramic windowed package contains lead-bearing solder)
סטטוס מחזור חיים Obsolete - last-time-buy inventory only —
Dedicated Inputs — 7
Propagation Delay (tPD) — 45 ns (max)
Maximum Counter Frequency (fCNT) — 50 MHz
Input Setup Time (tSU) — 7.5 ns
Output Drive Current (IOH/IOL) — 12 mA DC
Process Technology — CMOS
מתח אספקה — 5 V (nominal)
Program/Erase Method — UV (ceramic window)
Erase/Program Cycles — [DATA_NEEDED: minimum erase/program cycles]
Logic Family — TTL-compatible I/O

Datasheets ומשאבים

עיין בכל המוצרים צור BOM בקשת הצעת מחיר